Struktura a architektura počítačů
|
|
- Vilém Novotný
- před 5 lety
- Počet zobrazení:
Transkript
1 Struktura a architektura počítačů Systémová struktura počítače Programátorský model počítače Instrukční soubor I České vysoké učení technické Fakulta elektrotechnická Ver.1.20 J. Zděnek 2014
2 Programátorský model počítače Kontrolní seznam 1 Check list No.1 Programátorský model ALU aritmetická jednotka PC čítač instrukcí SP ukazatel zásobníku PSW stavové slovo procesoru Střadač Adresový prostor univ. registrů Adr. prostor paměti programu Adresový prostor paměti dat Adresový prostor zásobníku Adr. prostor vstupů/výstupů Umístění tabulky vekt.přerušení Mapování v/v do paměti Programmer s model ALU arithmetic logic unit PC program counter SP stack pointer PSW processor status word Accumulator Universal register addr. space Program memory addr. space Data memory addr. space Stack addr. space Input/output space Interrupt vector table space Memory mapped input/output A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 2
3 Programátorský model počítače ACCUMULATOR PC PROGRAM COUNTER ALU UNIVERSAL (SCRATCHPAD, GENERAL PURPOSE REGISTERS) REGISTER SPACE SP FLAGS STACK POINTER PROCESSOR STATUS WORD (PSW) DATA PATH WIDTH (, 16, 32, 64 bits) RESET PROGRAM MEMORY SPACE??? DATA MEMORY SPACE MEMORY MAPPED I/O INPUT/OUTPUT SPACE (SPECIAL FUNCTION REGISTERS)?????? INTERRUPT VECTOR TABLE STACK??? HW STACK (CPU) STACK LIMITED DEPTH A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 3
4 Oddělený prostor vstupů a výstupů RESET PROGRAM MEMORY SPACE DATA MEMORY SPACE INPUT/OUTPUT SPACE (SPECIAL FUNCTION REGISTERS - SFR) INTERRUPT VECTOR TABLE STACK A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 4
5 Mapování prostoru vstupů/výstupů do paměti RESET PROGRAM MEMORY SPACE DATA MEMORY SPACE INTERRUPT VECTOR TABLE STACK (SPECIAL FUNCTION REGISTERS - SFR) MEMORY MAPPED I/O A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 5
6 Hardwareový zásobník (v CPU) ACCUMULATOR PC PROGRAM COUNTER ALU UNIVERSAL (SCRATCHPAD, GENERAL PURPOSE REGISTERS) REGISTER SPACE SP FLAGS STACK POINTER PROCESSOR STATUS WORD (PSW) DATA PATH WIDTH (, 16, 32, 64 bits) RESET PROGRAM MEMORY SPACE DATA MEMORY SPACE HW STACK (CPU) STACK LIMITED DEPTH INTERRUPT VECTOR TABLE MEMORY MAPPED I/O SFR SPECIAL FUNCTION REGISTERS A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 6
7 Adresové módy (způsoby adresování operandů) Kontrolní seznam 2 Check list No. 2 Adresové módy Paměť dat Paměť programu Přímá adresa Nepřímá adresa Ukazatel do paměti Indexové adresování Bázová adresa + index Adresování pomocí bank Přemapování paměti Přístupová banka Skrytý paměťový prostor Addressing modes Data memory Program memory Direct address Indirect address Memory pointer Indexed addressing Base address + index Memory banking Remapping Access bank Hidden memory space A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 7
8 Přímá adresa (adresa součástí instrukce) 000h DATA MEMORY INSTRUCTION OPCODE DIRECT ADDRESS SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE FFFh A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I
9 Nepřímá adresa (adresa je v registru) INDIRECT ADDRESS DATA MEMORY POINTER 000h DATA MEMORY FSRx REGISTER ADDRESS SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE FFFh A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 9
10 Indexové adresování INDEXED ADDRESSING (BASE + INDEX) 000h DATA MEMORY 00h BSR 4 BANK 0 05Fh 060h ADDRESS CALCULATION BSR BANK ADDRESS + 00h + SHORT ADDRESS = DATA MEMORY ADDRESS BANK 1 BANK 14 0FFh 100h EFFh F00h FFh 00h FFh 00h SHORT ADDRESS INSIDE EACH BANK 00h-FFh BANK 15 F5Fh F60h WREG STATUS 5Fh 60h SFR SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE BANKING FFFh FFh A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 10
11 Dynamické přemapování a přímá adresa REMAPPING & SHORT DIRECT ADDRESS 000h DATA MEMORY 00h BANK 0 05Fh 060h 5Fh 60h 0FFh 100h FFh 00h GPR ACCESS BANK 00h DISABLED (HIDDEN) BANK 1 BANK 14 EFFh F00h FFh 00h SFR WREG STATUS 5Fh 60h FFh BANK 15 F5Fh F60h WREG STATUS 5Fh 60h SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE FFFh FFh REMAPPING A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 11
12 Struktura CPU versus operandy Kontrolní seznam 3 Check list No. 3 Struktura CPU versus operandy Orientovaný na zásobník ALU, PSW (Příznakový reg) zásobník Střadačově orientovaný ALU, PSW (Příznakový reg) Paměť dat Registrově orientovaný ALU, PSW (Příznakový reg) univerzální registry (v CPU) Paměťově orientovaný ALU, PSW, paměť dat CPU systems versus operands Stack oriented ALU, PSW (Flags) stack Accumulator oriented ALU, PSW (Flags), Accumulator Data memory Register oriented ALU,PSW (Flags) Universal (scratchpad) registers Memory oriented ALU, PSW (Flags), data memory A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 12
13 Struktura CPU versus operandy - 1 STACK TOS ALU FLAGS STATUS STACK ORIENTED CPU A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 13
14 Struktura CPU versus operandy - 2 DATA MEMORY ALU FLAGS STATUS ACCUMULATOR ACCUMULATOR ORIENTED CPU A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 14
15 Struktura CPU versus operandy - 3 REGISTERS (INSIDE CPU) ALU FLAGS STATUS REGISTER ORIENTED CPU A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 15
16 Struktura CPU versus operandy - 4 DATA MEMORY ALU FLAGS STATUS MEMORY ORIENTED CPU A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 16
17 Organizace počítače pic1f (paměť programu) Kontrolní seznam 4 Check list No. 4 Struktura počítače pic1f Pamět programu Čítač instrukcí (PC) Zásobník (hardwareový) Ukazatel zásobníku (SP) Registry vrcholu zásobníku Start po nulování (RESET) Tabulka vektorů přerušení Nižší priorita přerušení (adr.) Vyšší priorita přerušení (adr.) Adresový prostor paměti prog. Obsazený prostor paměti prog. Paměť FLASH pic1f computer structure Program memory Program counter (PC) Hardware stack Stack pointer (SP) Top of stactk (TOS) registers Reset vector Interrupt vector table Low priority vector (interrupt) High priority vector (interrupt) Program memory space Implemented prog. memory space FLASH memory A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 17
18 pic1f Family Program Memory PROGRAM COUNTER PROGRAM MEMORY SP STACK POINTER Top of Stack -TOS 5 PC STACK AF4h h 00000h 00001h RESET HIGH PRIORITY LOW PRIORITY RESET VECTOR HIGH PRIORITY INTERRUPT VECTOR LOW PRIORITY INTERRUPT VECTOR INTERRUPT VECTOR TABLE TOS REGISTERS TOSU 01h TOSH Ah TOSL F4h TABLE READ IMPLEMENTED MEMORY (FLASH) 01FFFh 01FFFFh CONFIG. WORDs PROGRAM MEMORY ADDRESS SPACE Read as 0 1FFFFFh 16 A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 1
19 Organizace počítače pic1f (paměť dat) Kontrolní seznam 5 Check list No. 5 Struktura počítače pic1f Pamět dat Universální registry (GPR) Ovládací registry periferií (SFR) Adresa paměti programu Registry nepřímé adresy (FSRx)) Adresování pomocí bank Bázový registr banky (BSR) Přemapování paměti Adresa uvnitř zvolené banky Adresa banky (0,1,,15) Stavové slovo procesoru (PSW) Střadač (WREG) pic1f computer structure Data memory General purpose registers (GPR) Special function registers (SFR) Register file address File select registers (FSRx) Banking Bank select register (BSR) Remapping Inner bank address Bank address (0,1,,15) Status (FLAGs, PSW) Working register (accumulator) A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 19
20 pic1f Family Data Memory BSR BANK ADDRESS 000h DATA MEMORY 00h ALU FSR0 4 BANK 0 05Fh 060h 5Fh 60h FSR1 FSR BANK 1 BANK 14 0FFh 100h EFFh F00h FFh 00h FFh 00h GPR ACCESS BANK WREG STATUS 00h 5Fh 60h FFh REGISTER FILE ADDRESS BANKING BANK 15 F5Fh F60h FFFh WREG STATUS 5Fh 60h FFh SFR ACCUMULATOR FLAGS (PSW) SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE REMAPING A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 20
21 pic1f Family Data Memory (Bank Addresses) FSR0 FSR1 BSR 4 12 BANK ADDRESS BANK 0 000h 05Fh 060h DATA MEMORY 00h 5Fh 60h ALU FSR FFh 100h FFh 00h GPR ACCESS BANK 00h BANK 0 BANK 1 BANK 2 BANK 3 BANK 4 BANK 5 BANK 6 BANK 7 BANK BANK 9 BANK 10 BANK 11 BANK 12 BANK 13 BANK 14 BANK 15 FSR2 000h 100h 200h 300h 400h 500h 600h 700h 00h 900h A00h B00h C00h D00h E00h F00h BSR 0h 1h 2h 3h 4h 5h 6h 7h h 9h Ah Bh Ch Dh Eh Fh BANK 1 BANK 14 REGISTER FILE ADDRESS BANK 15 EFFh F00h F5Fh F60h FFFh WREG STATUS FFh 00h 5Fh 60h FFh SFR ACCUMULATOR FLAGS (PSW) WREG STATUS SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE N OV Z DC C 5Fh 60h FFh A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 21
22 Organizace počítače pic1f (ALU, násobička) Kontrolní seznam 6 Check list No. 6 Struktura počítače pic1f Aritmetická a logická jednotka ALU (bitová) Násobička (x=16) Násobení bez znaménka Stavové slovo procesoru (PSW) Střadač (WREG) Registry součinu (PRODH,L) Universální registry (GPR) Ovládací registry periferií (SFR) Mapování v/v do paměti Operandy ALU z GPR i FSR pic1f computer structure Arithmetic and logic unit ALU (-bit) Multiplier (x=16) Unsigned multiplication Status (FLAGs, PSW) Working register (accumulator) Product register (PRODH,L) General purpose registers (GPR) Special function registers (SFR) Memory mapped input/output Orthogonal inst. set design A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 22
23 pic1f Family ALU and Multiplier ORTHOGONAL INSTRUCTION SET DESIGN SPECIAL FUNCTION REGISTERS (SFR) MEMORY MAPPED INPUT/OUTPUT SPACE DATA MEMORY/ REGISTER FILE GENERAL PURPOSE REGISTERS (GPR) WREG ALU ACCUMULATOR PRODH 16 MULTIPLIER (UNSIGNED) PRODL FLAGS STATUS ACCUMULATOR/REGISTER ORIENTED CPU A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 23
24 Organizace počítače pic1f systém přerušení Kontrolní seznam 7 Check list No. 7 Struktura počítače pic1f Systém přerušení Prioritní vs. neprioritní Dvouhladinový prioritní systém Zdroje přerušení Obslužná procedura přerušení Detektor událostí Inicializace systému přerušení Priorita přerušení Povolení přerušení Příznak žádosti o přerušení Obsluha přerušení Nulování žádostí o přerušení pic1f computer structure Interrupt system Priority vs. non-priority Two level priority system Interrupt resources Interrupt service routine (ISR) Event detector Interrupt system initialization Interrupt priority (IPEN, IPx) Interrupt enable (GIEH,GIEL,IEx) Interrupt flag (IFx) Interrupt service Interrupt flag (IFx) reset A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 24
25 pic1f Family Interrupt System High Priority Enable GIEH HIGH PRIORITY Priority Encoder INTRQ LOW PRIORITY xip yip GIEL IPEN xie yie Priority System On xif yif Low Priority Enable INPUT Event Detector Clk Timer Interrupt Priority INTERRUPT RESOURCES Interrupt Enable Interrupt Flag (Request) A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 25
26 Instrukční soubor počítače pic1f rozdělení Kontrolní seznam Check list No. Instrukční soubor počítače pic1f Pevná řádová čárka Přesuny operandů Aritmetické operace Posuny a rotace Logické operace Bitové operace Nepodmíněné skoky Absolutní, relativní Podmíněné skoky Volání podprogramu a návrat Řídící instrukce pic1f instruction set Fixed point Move operations Arithmetic operations Shift, Rotate operations Logical operations Bit operations Goto, Branch Direct, relative Conditional Branch Call, Return Control instructions A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 26
27 Přesuny Přesuny operandů paměť dat MOVxy - přesuň LFSR - nastav SWAP - zaměň půlslabiky (nibble) CLR - nuluj SET - nastav na FFh POP - vyzvedni položku z vrcholu zásobníku PUSH - ulož položku na vrchol zásobníku Přesuny operandů paměť programu TBLRD - table read (z FLASH) TBLWR - table write (do FLASH) A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 27
28 Aritmetické operace Aritmetické operace ADDxy - sečti ADDxyC - sečti včetně carry SUBxy - odečti SUBxyB - odečti včetně borrow MULxy - násob INCx - inkrementuj DECx - dekrementuj NEG - x = -x (dvojkový doplněk) DA - dekadická korekce CP - porovnej (komparuj)(odčítání bez uložení výsledku) TST - testuj A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 2
29 Posuny a rotace Posuny a rotace Rotace (Rotation) RLNC - rotuj vlevo bez carry (C) RLC - rotuj vlevo přes carry (C) RRNC - rotuj vpravo bez carry (C) RRC - rotuj vpravo přes carry (C) Posuny (Shifts) Posun vlevo (logický je shodný s aritmetickým) C=0 pak RLC Posun vpravo logický C=0 pak RRC Posun vpravo aritmetický Nejvyšší bit do C pak RRNC A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 29
30 Logické operace Logické operace (Logical Operations) ANDxy - AND IORxy - OR (inclusive or, nevýhradní nebo) XORxy - XOR (exclusive or, výhradní nebo) COM - x = NOT x A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 30
31 Bitové operace Bitové operace (Bit-oriented Operations) BCx - nuluj bit BSx - nastav bit BTxSC - testuj bit (skip if clear) BTxSS - testuj bit (skip if set) BTG - otoč bit (bit toggle) A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 31
32 Skoky (větvení programu bez uložení návratové adresy) Nepodmíněné skoky (Unconditional Jump) GOTO - přejdi na (absolutní adresa), celý prostor pam.prog. BRA - přejdi na (relativní adresa -1024, +1023) Podmíněné skoky (Conditional Jump)(relativní adresa -12, +127) Testují bity stavového slova (C, N, Z, OV) BC - Branch if Carry (C=1) BNC - Branch if Not Carry (C=0) BN - Branch if Negative (N=1) BNN - Branch if Not Negative (N=0) BZ - Branch if Zero (Z=1) (výsledek je 0) BNZ - Branch if Not Zero (Z=0) (výsledek není 0) BOV - Branch if Overflow (OV=1) BNOV - Branch if Not Overflow (OV=0) A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 32
33 Volání podprogramu a návrat z podprogramu Volání podprogramu (Procedure Call) CALL - absolutní adresa, cellý prostor paměti programu RCALL - relativní adresa, -1024, Návrah z podprogramu (Return from Procedure) RETLW - návrat z procedur, hodnota ve WREG RETURN - návrat z podprogramu RETFIE - návrat z ISR, povolí přerušení od dané hladiny A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 33
34 Řídící instrukce Control instructions NOP - prázdná operace (No Operation) RESET - programové nulování procesoru CLRWDT - nulování hlídacího časovače (Watchdog) SLEEP - přechod do módu se sníženou spotřebou A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 34
35 pic1f Family Program Memory PROGRAM COUNTER PROGRAM MEMORY SP STACK POINTER Top of Stack -TOS 5 PC STACK AF4h h 00000h 00001h RESET HIGH PRIORITY LOW PRIORITY RESET VECTOR HIGH PRIORITY INTERRUPT VECTOR LOW PRIORITY INTERRUPT VECTOR INTERRUPT VECTOR TABLE TOS REGISTERS TOSU 01h TOSH Ah TOSL F4h TABLE READ IMPLEMENTED MEMORY (FLASH) 01FFFh 01FFFFh CONFIG. WORDs PROGRAM MEMORY ADDRESS SPACE Read as 0 1FFFFFh 16 A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 35
36 pic1f Family Program Memory Direct Address REMAPPING & SHORT DIRECT ADDRESS 000h DATA MEMORY 00h BANK 0 05Fh 060h 5Fh 60h 0FFh 100h FFh 00h GPR ACCESS BANK 00h DISABLED (HIDDEN) BANK 1 BANK 14 EFFh F00h FFh 00h SFR WREG STATUS 5Fh 60h FFh BANK 15 F5Fh F60h WREG STATUS 5Fh 60h SPECIAL FUNCTION REGISTERS MEMORY MAPPED INPUT/OUTPUT SPACE FFFh FFh REMAPPING A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 36
37 Příklad program v ASM PIC1F - 1 #include <P1F7J11.INC> ; processor specific variable definitions CONFIG FOSC = HS ; High speed oscilator CONFIG WDTEN = OFF ; Watchdog disabled CONFIG XINST = OFF ; Istruction set extension disabled #define TIMER0_16bit b' UDATA_ACS ; variable declaration part WREG_TEMP res 1 ; variable used for context saving STATUS_TEMP res 1 ; variable used for context saving BSR_TEMP res 1 ; variable used for context saving REG res 1 TEMP res 1 DIREKTIVY INSTRUKCE PROMĚNNÉ KONSTANTY KOMENTÁŘ CODE ORG 0x00000 goto Main ORG 0x0000 goto HighInt ; program code part ; go to start of main code ; go to high priority interrupt routine A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 37
38 Příklad program v ASM PIC1F - 2 Main: movlw 0x00 ; store 0 to W movwf TRISD ; W -> TRISD - all bits of PORTD are outputs movwf TRISB ; W -> TRISB - all bits of PORTB are outputs movwf PORTD ; W -> PORTD - PORTD value is 0 movwf REG ; W -> REG - REG value is O bsf TRISB,0,0 ; bit 0 of PORTB set as input movlw b' ' ; 0x02 -> W movwf T0CON ; Timer0 off, configured as 16 bit counter; movlw 0A0h ; b, 0A0h -> W movwf INTCON ; INTCON configured as - Interrupts enabled movlw 04h ; b, 04h -> W movwf INTCON2 ; Timer0 overflow int. priority set to High movlw b' ' ; b, 00h -> W movwf RCON ; enables priority levels on interrupts bsf T0CON,7,0 ; start Timer0 Loop: goto Loop ;loop forever (background program level) A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 3
39 Příklad program v ASM PIC1F - 3 HighInt: ; ISR start (Interrupt Service Routine) ; Save context and clear interrupt flag movff STATUS,STATUS_TEMP ; save STATUS register movff WREG,WREG_TEMP ; save working register movff BSR,BSR_TEMP ; save BSR register bcf INTCON,2,0 ; clear Interrupt Flag ; Interrupt service action rlncf REG,1,0 ; rotation to left btfss PORTB,0,0 ; is RB0 pressed? bsf REG,0,0 ; set bit 0 of REG to 1 movff REG,PORTD ; REG -> PORTD ; Restore context movff BSR_TEMP,BSR ; restore BSR register movff WREG_TEMP,WREG ; restore working register movff STATUS_TEMP,STATUS ; restore STATUS register ; Return from ISR (Note: special instruction retfie to be interrupt reenabled retfie ; return from interrupt END A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 39
40 Struktura a architektura počítačů Systémová struktura počítače Programátorský model počítače Instrukční soubor I KONEC České vysoké učení technické Fakulta elektrotechnická A7B14SAP Struktura a architektura počítačů 7 - Programátorský model, instrukční soubor I 40
MIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY. Systém přerušení. České vysoké učení technické Fakulta elektrotechnická
MIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY Systém přerušení České vysoké učení technické Fakulta elektrotechnická A1B14MIS Mikroprocesory pro výkonové systémy 6 Ver.1.2 J. Zděnek, 213 1 pic18f Family Interrupt
VíceStruktura a architektura počítačů
Struktura a architektura počítačů Systémová struktura počítače Řízení běhu programu Systém přerušení České vysoké učení technické Fakulta elektrotechnická Ver.1.30 J. Zděnek / M. Chomát 2014 Požadované
VíceAlgoritmizace a programování
Algoritmizace a programování Struktura počítače - pokračování České vysoké učení technické Fakulta elektrotechnická Ver.1.10 J. Zděnek 2015 Systémová struktura počítače pokrač. Systém přerušení A8B14ADP
VíceStruktura a architektura počítačů
Struktura a architektura počítačů Systémová struktura počítače Instrukční soubor II Příklady návrhu České vysoké učení technické Fakulta elektrotechnická Ver.1.30 J. Zděnek / M. Chomát 2014 Assembler (Jazyk
VíceMIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY. Systémová struktura počítače
MIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY Systémová struktura počítače Řízení běhu programu České vysoké učení technické Fakulta elektrotechnická A1B14MIS Mikroprocesory pro výkonové systémy 05 Ver.1.20 J. Zděnek,
VíceŘÍZENÍ ELEKTRICKÝCH POHONŮ. Systémová struktura počítače Řízení běhu programu. České vysoké učení technické Fakulta elektrotechnická
ŘÍZENÍ ELEKTRICKÝCH POHONŮ Systémová struktura počítače Řízení běhu programu České vysoké učení technické Fakulta elektrotechnická A1M14RPO Řízení elektrických pohonů 01 Ver.1.20 J. Zděnek, 20151 Požadované
VíceSystém přerušení. Algoritmizace a programování. Struktura počítače - pokračování. Systémová struktura počítače pokrač.
Algoritmizace a programování Struktura počítače - pokračování České vysoké učení technické Fakulta elektrotechnická Ver.1.10 J. Zděnek 2015 Systémová struktura počítače pokrač. Systém přerušení A8B14ADP
VícePopis instrukční sady - procesory PIC Aritmetické a logické operace
Popis instrukční sady - procesory PIC Aritmetické a logické operace ADDLW - ADD Literal and W ADDLW k (W+k) W Sečte obsah registru W s konstantou k, výsledek uloží do registru Ovlivňuje: C, DC, Z ADDWF
VíceMIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY. Stručný úvod do programování v jazyce C 2.díl. České vysoké učení technické Fakulta elektrotechnická
MIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY Stručný úvod do programování v jazyce C 2.díl České vysoké učení technické Fakulta elektrotechnická A1B14MIS Mikroprocesory pro výkonové systémy 07 Ver.1.10 J. Zděnek,
VíceStruktura a architektura počítačů
Struktura a architektura počítačů Aritmetické operace Pevná a pohyblivá řádová čárka České vysoké učení technické Fakulta elektrotechnická Ver.1.30 J. Zděnek / M. Chomát 2014 Aritmetické operace pevná
VíceProcesor z pohledu programátora
Procesor z pohledu programátora Terminologie Procesor (CPU) = řadič + ALU. Mikroprocesor = procesor vyrobený monolitickou technologií na čipu. Mikropočítač = počítač postavený na bázi mikroprocesoru. Mikrokontrolér
VíceVážení zákazníci, dovolujeme si Vás upozornit, že na tuto ukázku knihy se vztahují autorská práva, tzv. copyright. To znamená, že ukázka má sloužit výhradnì pro osobní potøebu potenciálního kupujícího
VíceČinnost CPU. IMTEE Přednáška č. 2. Několik úrovní abstrakce od obvodů CPU: Hodinový cyklus fáze strojový cyklus instrukční cyklus
Činnost CPU Několik úrovní abstrakce od obvodů CPU: Hodinový cyklus fáze strojový cyklus instrukční cyklus Hodinový cyklus CPU je synchronní obvod nutné hodiny (f CLK ) Instrukční cyklus IF = doba potřebná
VícePopis instrukční sady procesoru ADOP
instrukční sady procesoru ADOP ČVUT FEL, 2008 K. Koubek, P. Bulena Obsah instrukční sady...5 Univerzální registry...5 Registr příznaků FR...5 Standardní význam příznaků...6 Přehled instrukcí...7 ADD Add...8
VíceJednočipové mikropočítače (mikrokontroléry)
Počítačové systémy Jednočipové mikropočítače (mikrokontroléry) Miroslav Flídr Počítačové systémy LS 2006-1/17- Západočeská univerzita v Plzni Co je mikrokontrolér integrovaný obvod, který je často součástí
VíceStruktura a architektura počítačů
Struktura a architektura počítačů Aritmetické operace Pevná a pohyblivá řádová čárka České vysoké učení technické Fakulta elektrotechnická Ver..2 J. Zděnek 23 Aritmetické operace pevná řádová čárka Pevná
VíceVážení zákazníci, dovolujeme si Vás upozornit, že na tuto ukázku knihy se vztahují autorská práva, tzv. copyright. To znamená, že ukázka má sloužit výhradnì pro osobní potøebu potenciálního kupujícího
VíceMIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY
MIKROPROCESORY PRO VÝKONOVÉ SYSTÉMY Stručný úvod do programování v jazyce C 2.díl České vysoké učení technické Fakulta elektrotechnická A1B14MIS Mikroprocesory pro výkonové systémy 07 Ver.1.10 J. Zděnek,
VíceProcesor. Základní prvky procesoru Instrukční sada Metody zvýšení výkonu procesoru
Počítačové systémy Procesor Miroslav Flídr Počítačové systémy LS 2006-1/17- Západočeská univerzita v Plzni Víceúrovňová organizace počítače Digital logic level Microarchitecture level Processor Instruction
VíceSeznámení s mikropočítačem. Architektura mikropočítače. Instrukce. Paměť. Čítače. Porovnání s AT89C2051
051 Seznámení s mikropočítačem Architektura mikropočítače Instrukce Paměť Čítače Porovnání s AT89C2051 Seznámení s mikropočítačem řady 8051 Mikroprocesor řady 8051 pochází z roku 1980 a je vytvořené firmou
Vícea operačních systémů
NSWI2 2/2 ZS Principy počítačů a operačních systémů INSTRUKCE Kdybych nařídil generálovi, aby létal od květině ke květině a on by rozkaz neprovedl, nebyla by to chyba generálova, ale moje. král asteroidu
VíceFaculty of Nuclear Sciences and Physical Engineering Czech Technical University in Prague
Tomáš Faculty of Nuclear Sciences and Physical Engineering Czech Technical University in Prague Zjednodušené schéma systému z základ hardware pro mainframe tvoří: operační pamět - MAIN / REAL STORAGE jeden
VíceArchitektura jednočipových mikropočítačů PIC 16F84 a PIC 16F877. Tato prezentace vznikla jako součást řešení projektu FRVŠ 2008/566.
Počítačové systémy Jednočipové mikropočítače II Architektura jednočipových mikropočítačů PIC 16F84 a PIC 16F877 Tato prezentace vznikla jako součást řešení projektu FRVŠ 2008/566. Miroslav Flídr Počítačové
VíceKubatova 19.4.2007 Y36SAP 8. Strojový kód Jazyk symbolických instrukcí asembler JSA pro ADOP a AVR. 2007-Kubátová Y36SAP-strojový kód 1
Y36SAP 8 Strojový kód Jazyk symbolických instrukcí asembler JSA pro ADOP a AVR 2007-Kubátová Y36SAP-strojový kód 1 Architektura souboru instrukcí, ISA - Instruction Set Architecture Vysoká Architektura
VíceStrojový kód k d a asembler procesoru MIPS SPIM. MIPS - prostředí NMS NMS. 32 ks 32bitových registrů ( adresa registru = 5 bitů).
Strojový kód k d a asembler procesoru MIPS Použit ití simulátoru SPIM K.D. - cvičení ÚPA 1 MIPS - prostředí 32 ks 32bitových registrů ( adresa registru = 5 bitů). Registr $0 je zero čte se jako 0x0, zápis
VíceAlgoritmizace a programování
Algoritmizace a programování Struktura počítače České vysoké učení technické Fakulta elektrotechnická Ver.1.10 J. Zděnek 2015 Struktura předmětu Systémová struktura počítače, procesor, paměti, periferní
VíceProgramování PICAXE18M2 v Assembleru
Nastavení programming editoru PICAXE PROGRAMMING EDITOR 6 Programování PICAXE18M2 v Assembleru Nastavit PICAXE Type PICAXE 18M2(WJEC-ASSEMBLER, stejně tak nastavit Simulation Pokud tam není, otevřeme přes
VíceMikrořadiče řady 8051.
Mikrořadiče řady 8051 Řada obvodů 8051 obsahuje typy 8051AH, 8031AH, 8751H, 80C51, 80C31, 8052 a 8032 Jednotlivé obvody se od sebe liší technologií výroby a svojí konstrukcí Způsob programování je však
VíceStruktura a architektura počítačů (BI-SAP) 7
Evropský sociální fond Praha & EU: Investujeme do vaší budoucnosti Struktura a architektura počítačů (BI-SAP) 7 doc. Ing. Hana Kubátová, CSc. Katedra číslicového návrhu Fakulta informačních technologii
VíceRISC a CISC architektura
RISC a CISC architektura = dva rozdílné přístupy ke konstrukci CPU CISC (Complex Instruction Set Computer) vývojově starší přístup: pomoci konstrukci překladače z VPP co nejpodobnějšími instrukcemi s příkazy
VíceStrojový kód. Instrukce počítače
Strojový kód Strojový kód (Machine code) je program vyjádřený v počítači jako posloupnost instrukcí procesoru (posloupnost bajtů, resp. bitů). Z hlediska uživatele je strojový kód nesrozumitelný, z hlediska
VíceVstup-výstup Input-Output Přehled a obsluha
ÚVOD DO OPERAČNÍCH SYSTÉMŮ Vstup-výstup Input-Output Přehled a obsluha České vysoké učení technické Fakulta elektrotechnická Y38ÚOS Úvod do operačních systémů 12 Ver.1.00 2010 Operační systém (Operating
VíceZáklady digitální techniky
Základy digitální techniky Binarna aritmetika. Tabulky Karno. Operace logické a aritmetické; Binarna aritmetika. č. soust zákl. Abeceda zápis čísla binarní B=2 a={0,1} 1100 oktalová B=8 a={0,1,2,3,4,5,6,7}
VíceKubatova 19.4.2007 Y36SAP - 13. procesor - control unit obvodový a mikroprogramový řadič RISC. 19.4.2007 Y36SAP-control unit 1
Y36SAP - 13 procesor - control unit obvodový a mikroprogramový řadič RISC 19.4.2007 Y36SAP-control unit 1 Von Neumannova architektura (UPS1) Instrukce a data jsou uloženy v téže paměti. Paměť je organizována
VíceAlgoritmizace a programování
Algoritmizace a programování Struktura počítače České vysoké učení technické Fakulta elektrotechnická Ver.1.10 J. Zděnek 2015 Struktura předmětu Systémová struktura počítače, procesor, paměti, periferní
Více6. Členění počítačového hardware Architektura procesoru, Paměťová hierarchie, Systémová rozhranní, Uživatelská rozhraní
1. Základní vlastnosti číslicového počítače: Nespojité diskrétní (digitální, číslicové) zobrazení dat 2. Mooreův zákon o vývoji hustoty integrace Procesory: Logická kapacita: o 30% za rok, Hodinová frekvence:
Více8. Laboratoř: Aritmetika a řídicí struktury programu
8. Laboratoř: Aritmetika a řídicí struktury programu Programy v JSA aritmetika, posuvy, využití příznaků Navrhněte a simulujte v AVR studiu prográmky pro 24 bitovou (32 bitovou) aritmetiku: sčítání, odčítání,
VíceStruktura a architektura počítačů (BI-SAP) 9
Evropský sociální fond Praha & EU: Investujeme do vaší budoucnosti Struktura a architektura počítačů (BI-SAP) 9 doc. Ing. Hana Kubátová, CSc. Katedra číslicového návrhu Fakulta informačních technologii
VíceIMTEE Přednáška č. 8. interrupt vector table CPU při vzniku přerušení skáče na pevně dané místo v paměti (obvykle začátek CODE seg.
Přerušení Důvod obsluha asynchronních událostí (CPU mnohem rychlejší než pomalé periferie má klávesnice nějaké znaky? ) Zdroje přerušení interrupt source o HW periferie (UART, Disk, časovače apod.) o SW
VíceMikrořadiče. Ing. Jaroslav Bernkopf
Mikrořadiče Ing. Jaroslav Bernkopf 18. září 2016 OBSAH 1. Úvod... 4 2. Architektura počítačů... 5 2.1 Architektura Von Neumannova... 5 2.2 Architektura Harvardská... 6 2.3 Soubory instrukcí... 6 2.3.1
VíceIMTEE Přednáška č. 11
AVR Libc pokračování interrupt.h práce s přerušením povolení / zakázání přerušení o makro sei() = instrukce sei o makro cli() = instrukce cli obslužné funkce vždy tvar ISR(JMENO_VEKTORU) // obslužný kod
VíceMikrokontroléry PIC a vestavěné systémy. PIC18 použití assembleru a jazyka C
Mikrokontroléry PIC a vestavěné systémy PIC18 použití assembleru a jazyka C Uvnitř CPU Program, uložený v paměti, obsahuje instrukce pro centrální jednotku k provedení akce. Akce mohou jednoduše sčítat
Více4-1 4. Přednáška. Strojový kód a data. 4. Přednáška ISA. 2004-2007 J. Buček, R. Lórencz
4-4. Přednáška 4. Přednáška ISA J. Buček, R. Lórencz 24-27 J. Buček, R. Lórencz 4-2 4. Přednáška Obsah přednášky Násobení a dělení v počítači Základní cyklus počítače Charakteristika třech základní typů
VíceKubatova Y36SAP 9. Strojový kód ISA architektura souboru instrukcí střadačově, zásobníkově orientovaná, GPR Kubátová Y36SAP-ISA 1
Y36SAP 9 Strojový kód ISA architektura souboru instrukcí střadačově, zásobníkově orientovaná, GPR 2007-Kubátová Y36SAP-ISA 1 Architektura souboru instrukcí, ISA - Instruction Set Architecture Vysoká Architektura
VíceMicrochip. PICmicro Microcontrollers
Microchip PICmicro Microcontrollers 8-bit 16-bit dspic Digital Signal Controllers Analog & Interface Products Serial EEPROMS Battery Management Radio Frequency Device KEELOQ Authentication Products Návrh
VícePřerušení POT POT. Přerušovací systém. Přerušovací systém. skok do obslužného programu. vykonávaný program. asynchronní událost. obslužný.
1 Přerušení Při výskytu určité události procesor přeruší vykonávání hlavního programu a začne vykonávat obslužnou proceduru pro danou událost. Po dokončení obslužné procedury pokračuje výpočet hlavního
VíceProcesory, mikroprocesory, procesory na FPGA. 30.1.2013 O. Novák, CIE 11 1
Procesory, mikroprocesory, procesory na FPGA 30.1.2013 O. Novák, CIE 11 1 Od sekvenčních automatů k mikroprocesorům 30.1.2013 O. Novák, CIE 11 2 30.1.2013 O. Novák, CIE 11 3 Architektura počítačů Von Neumannovská,
VíceOpakování programování
Opakování programování HW návaznost - procesor sběrnice, instrukční sada, optimalizace rychlosti, datové typy, operace (matematické, logické, podmínky, skoky, podprogram ) - paměti a periferie - adresování
Vícex86 assembler and inline assembler in GCC
x86 assembler and inline assembler in GCC Michal Sojka sojkam1@fel.cvut.cz ČVUT, FEL License: CC-BY-SA 4.0 Useful instructions mov moves data between registers and memory mov $1,%eax # move 1 to register
VíceISU Cvičení 3. Marta Čudová
ISU Cvičení 3 Marta Čudová Supercomputing Technologies Research Group Brno University of Technology, Faculty of Information Technology Božetěchova 1/2, 612 66 Brno - Královo Pole icudova@fit.vutbr.cz Program
VíceČísla, reprezentace, zjednodušené výpočty
Čísla, reprezentace, zjednodušené výpočty Přednáška 5 A3B38MMP kat. měření, ČVUT - FEL, Praha J. Fischer A3B38MMP, 2015, J.Fischer, ČVUT - FEL, kat. měření 1 Čísla 4 bitová dec bin. hex. 0 0000 0 1 0001
VíceZáklady informatiky. 2. Přednáška HW. Lenka Carr Motyčková. February 22, 2011 Základy informatiky 2
Základy informatiky 2. Přednáška HW Lenka Carr Motyčková February 22, 2011 Základy informatiky 1 February 22, 2011 Základy informatiky 2 February 22, 2011 Základy informatiky 3 February 22, 2011 Základy
VíceAdresní mody procesoru
Adresní mody procesoru K.D. - přednášky 1 Obecně o adresování Různé typy procesorů mohou mít v instrukci 1, 2 nebo více adres. Operandy mohou ležet v registrech nebo v paměti. Adresní mechanismus procesoru
VíceMIKROKONTROLERY PIC16F84
Střední odborná škola a Střední odborné učiliště informatiky a spojů, Brno, Čichnova 23 Pracovní sešit MIKROKONTROLERY PIC16F84 Určeno pro obory Mechanik elektronik, Digitální telekomunikační technika
VíceArchitektura počítačů. Instrukce a návrh instrukční sady. Lubomír Bulej KDSS MFF UK
Architektura počítačů Instrukce a návrh instrukční sady Lubomír Bulej KDSS MFF UK Pro připomenutí: počítač je (jen) stroj Vykonává program Posloupnost instrukcí uložených v paměti. Vykoná instrukci a posune
VícePrincip funkce počítače
Princip funkce počítače Princip funkce počítače prvotní úlohou počítačů bylo zrychlit provádění matematických výpočtů první počítače kopírovaly obvyklý postup manuálního provádění výpočtů pokyny pro zpracování
VíceRegistry 32 bitové pro všeobecné použití: EAX, EBX, ECX, EDX, ESI, EDI, EBP, ESP.
1 Procesor i486 a vyšší - úvodní seznámení Procesory i486 a vyšší jsou v technické literatuře dobře dokumentovány, ale dokumentace je rozsáhlá a obsahuje pro začínajícího i zkušeného programátora mnoho
VíceStruktura a architektura počítačů
Struktura a architektura počítačů Alfanumerické kódy Řadič procesoru CISC, RISC Pipelining České vysoké učení technické Fakulta elektrotechnická Ver 1.20 J. Zděnek 2014 Alfanumerické kódy Kódování zobrazitelných
VíceMetody připojování periferií BI-MPP Přednáška 2
Metody připojování periferií BI-MPP Přednáška 2 Ing. Miroslav Skrbek, Ph.D. Katedra počítačových systémů Fakulta informačních technologií České vysoké učení technické v Praze Miroslav Skrbek 2010,2011
VíceJiøí Hrbáèek MIKROØADIÈE PIC16CXX a vývojový kit PICSTART Kniha poskytuje ètenáøi základní informace o mikroøadièích øady PIC 16CXX, jejich vlastnostech a použití tak, aby je mohl využít pøi vlastních
VíceISU Cvičení 7. Marta Čudová
ISU Cvičení 7 Marta Čudová Supercomputing Technologies Research Group Brno University of Technology, Faculty of Information Technology Božetěchova 1/2, 612 66 Brno - Královo Pole icudova@fit.vutbr.cz Osnova
Vícedspic33: Přerušení, čítače a Change Notification
1 z 6 26.3.2013 14:28 dspic33: Přerušení, čítače a Change Notification Přerušení Základní pojmy: přerušení maskování priority Preruseni na dspic33-fj128-mc804 15 priority levels Up to eight processor exceptions
VíceJednočipové mikropočítače
Jednočipové mikropočítače Atmel AVR 90S8515 činnost procesoru si budeme demonstrovat na jednočipovém mikropočítači AVR 90S8515 firmy Atmel jednočipové mikropočítače mikropočítače, obsahující na jednom
VíceProcesory z řady 8051
Procesory z řady 8051 A/D a D/A převodníky, komparátory Nízký příkon napájení 3,3V Malá pouzdra pro plošnou montáž Programová Flash OTP-EPROM Redukované nebo rozšířené I/O vývody Jádro 80C51 Kapacita programu
VíceMSP 430F1611. Jiří Kašpar. Charakteristika
MSP 430F1611 Charakteristika Mikroprocesor MSP430F1611 je 16 bitový, RISC struktura s von-neumannovou architekturou. Na mikroprocesor má neuvěřitelně velkou RAM paměť 10KB, 48KB + 256B FLASH paměť. Takže
VíceMonolitické mikropoèítaèe II
Monolitické mikropoèítaèe II zpracoval Ing. Josef Šabata Volně navazujeme na Kurs monolitických mikropočítačů a budeme se věnovat výrobkům firmy Arizona Microchip Inc., které jsou i u nás známé jako PIC
VíceArchitektury VLIW M. Skrbek a I. Šimeček
Architektury VLIW M. Skrbek a I. Šimeček xsimecek@fit.cvut.cz Katedra počítačových systémů FIT České vysoké učení technické v Praze Ivan Šimeček, 2011 MI-PAP, LS2010/11, Predn.3 Příprava studijního programu
VíceČísla, reprezentace, zjednodušené výpočty
Čísla, reprezentace, zjednodušené výpočty Přednáška 4 A3B38MMP kat. měření, ČVUT - FEL, Praha J. Fischer A3B38MMP, 2014, J.Fischer, ČVUT - FEL, kat. měření 1 Čísla 4 bitová dec bin. hex. 0 0000 0 1 0001
VíceArchitektura počítače Základní bloky Provádění instrukcí
ÚVOD DO OPERAČNÍCH SYSTÉMŮ Architektura počítače Základní bloky Provádění instrukcí České vysoké učení technické Fakulta elektrotechnická Y38ÚOS Úvod do operačních systémů 01 Ver.1.01 2011 Hodnocení předmětu
VíceOrganizace pam ového prostoru 1
Organizace pam ového prostoru 1 1.0. Celový popis Tento popis obsahuje návod pro použití jedno ipového miropo íta e PIC 16F84A. Další informace m žete nalézt v PICmicro Mid-Range Reference Manual, (DS33023),
VícePetr Krajča. Katedra informatiky Univerzita Palackého v Olomouci. Petr Krajča (UP) KMI/YOS: Přednáška I. 10. 10. 2014 1 / 21
Operační systémy Úvod do Operačních Systémů Petr Krajča Katedra informatiky Univerzita Palackého v Olomouci Petr Krajča (UP) KMI/YOS: Přednáška I. 10. 10. 2014 1 / 21 Organizační informace email: petr.krajca@upol.cz
VíceJazyk symbolických adres
Jazyk symbolických adres 1 Proč programovat v JSA Pro některé procesory resp. MCU jsou překladače JSA dostupnější. Některé překladače vyšších jazyků neumí využít určité speciální vlastnosti procesoru.
VíceStruktura a architektura počítačů (BI-SAP) 8
Evropský sociální fond Praha & EU: Investujeme do vaší budoucnosti Struktura a architektura počítačů (BI-SAP) 8 doc. Ing. Hana Kubátová, CSc. Katedra číslicového návrhu Fakulta informačních technologii
VíceMIKROPOČÍTAČOVÉ SYSTÉMY
MIKROPOČÍTAČOVÉ SYSTÉMY Jednočipové mikropočítače řady 805 Vytištěno z dokumentů volně dostupných na Webu Mikroprocesory z řady 805 Mikroprocesor 805 pochází z roku 980 a je vývojově procesorem relativně
VíceKlimatizace. Třída: 4.C. Střední Průmyslová Škola Elektrotechnická Havířov Protokol do MIT. Skupina: 3. Zpráva číslo: 3
Střední Průmyslová Škola Elektrotechnická Havířov Protokol do MIT Třída: 4.C Skupina: 3 Klimatizace Zpráva číslo: 3 Dne: 08.01.2007 Soupis použitých přístrojů: přípravek s μc 8051 přípravek s LCD přípravek
VíceOsmibitové mikrořadiče Microchip PIC16F1937
Osmibitové mikrořadiče Microchip PIC16F1937 SPŠElit Dobruška, 2014 Ing Josef Hloušek Tento text může být využíván pro podporu výuky předmětu Mikroprocesorové systémy ve 3. a 4. ročníku oboru Aplikace osobních
VíceSemestrální práce z předmětu. Jan Bařtipán / A03043 bartipan@studentes.zcu.cz
Semestrální práce z předmětu KIV/UPA Jan Bařtipán / A03043 bartipan@studentes.zcu.cz Zadání Program přečte ze vstupu dvě čísla v hexadecimálním tvaru a vypíše jejich součet (opět v hexadecimální tvaru).
VícePohled do nitra mikroprocesoru Josef Horálek
Pohled do nitra mikroprocesoru Josef Horálek Z čeho vycházíme = Vycházíme z Von Neumannovy architektury = Celý počítač se tak skládá z pěti koncepčních bloků: = Operační paměť = Programový řadič = Aritmeticko-logická
VíceČESKÉ VYSOKÉ UČENÍ TECHNICKÉ V PRAZE
Vzorový příklad pro práci v prostředí MPLAB Zadání: Vytvořte program, který v intervalu 200ms točí doleva obsah registru reg, a který při stisku tlačítka RB0 nastaví bit 0 v registru reg na hodnotu 1.
VíceMetody připojování periferií
Metody připojování periferií BI-MPP Přednáška 3 Ing. Miroslav Skrbek, Ph.D. Katedra počítačových systémů Fakulta informačních technologií České vysoké učení technické v Praze Miroslav Skrbek 2010,2011
VíceProgramátorský model procesoru x51
Programátorský model procesoru x51 Základní schéma procesoru V rámci cvičení tohoto předmětu budeme programovat jeden konkrétní procesor řady x51. Abychom ho mohli začít programovat, musíme si nejprve
Více+---------------------------------------------------------------+ +-----------------------------------------------------------+
+---------------------------------------------------------------+ +-----------------------------------------------------------+ AA SSSS MM MM AAAA SS SS MMM MMM AA AA SS MM M M MM AA AA SSSSS MM M M MM
VíceMikrokontroléry. Doplňující text pro POS K. D. 2001
Mikrokontroléry Doplňující text pro POS K. D. 2001 Úvod Mikrokontroléry, jinak též označované jako jednočipové mikropočítače, obsahují v jediném pouzdře všechny podstatné části mikropočítače: Řadič a aritmetickou
Více3. Počítačové systémy
3. Počítačové systémy 3.1. Spolupráce s počítačem a řešení úloh 1. přímý přístup uživatele - neekonomické. Interakce při odlaďování programů (spusť., zastav.,krok, diagnostika) 2. dávkové zpracování (batch
VíceArchitektury počítačů a procesorů
Kapitola 3 Architektury počítačů a procesorů 3.1 Von Neumannova (a harvardská) architektura Von Neumann 1. počítač se skládá z funkčních jednotek - paměť, řadič, aritmetická jednotka, vstupní a výstupní
VíceObr. 1 - Hlavní okno prostředí MPLAB
BDOM Cvičení 1 1. Prostředí MPLAB Pro práci s obvody MICROCHIP PIC budeme používat vývojové prostředí MPLAB a programátor MPLAB ICD 2. Tento programátor je připojen k vývojové desce PICkit 2. Po spuštění
VíceDalší aspekty architektur CISC a RISC Aktuálnost obsahu registru
Cíl přednášky: Vysvětlit principy práce s registry v architekturách RISC a CISC, upozornit na rozdíly. Vysvětlit možnosti využívání sad registrů. Zabývat se principy využívanými v procesorech Intel. Zabývat
Vícezení Koncepce připojení V/V zařízení POT POT ... V/V zařízení jsou připojena na sběrnici pomocí řadičů. Řadiče Připojení periferních zařízení
Připojení periferních zařízen zení 1 Koncepce připojení V/V zařízení V/V zařízení jsou připojena na sběrnici pomocí řadičů. Řadiče specializované (řadič disku) lze k nim připojit jen zařízení určitého
VícePrincipy komunikace s adaptéry periferních zařízení (PZ)
Principy komunikace s adaptéry periferních zařízení (PZ) Několik možností kategorizace principů komunikace s externími adaptéry, např.: 1. Podle způsobu adresace registrů, které jsou součástí adaptérů.
VíceÚstav radioelektroniky. 18. prosince 2007
Ústav radioelektroniky Vysoké učení technické v Brně Programování signálových procesorů Mikroprocesorová technika, přednáška č. 13 Ing. Frýza Tomáš, Ph.D. 18. prosince 2007 Obsah přednášky Architektury
VíceA51 MACRO ASSEMBLER POKUSNY PROGRAM DATE 10/3/007 PAGE 1
Demonstrač nítext k předná š ce Mikroprocesory v přístrojové technice, kat. měření. A51 MACRO ASSEMBLER POKUSNY PROGRAM DATE 10/3/007 PAGE 1 MS-DOS MACRO ASSEMBLER A51 V4.4 OBJECT MODULE PLACED IN DEMC.OBJ
VíceAssembler - 2.část. poslední změna této stránky: Zpět
1 z 9 19.2.2007 7:51 Assembler - 2.část poslední změna této stránky: 9.2.2007 1. Příznaky (flagy) Zpět Flagy (česky podivně "příznaky", proto používám výhradně anglický název) jsou výlučnou záležitostí
VíceArchitektura počítače
Architektura počítače Výpočetní systém HIERARCHICKÁ STRUKTURA Úroveň aplikačních programů Úroveň obecných funkčních programů Úroveň vyšších programovacích jazyků a prostředí Úroveň základních programovacích
VíceOsmibitové mikrořadiče Microchip PIC16F887
Osmibitové mikrořadiče Microchip PIC16F887 SPŠE Dobruška, učební text, 2009 Ing Josef Hloušek Tento učební text je určen pro výuku předmětu Mikropočítačové systémy ve 4. ročníku oboru Elekrotechnika. Cílem
VíceOperační systémy. Tomáš Vojnar IOS 2009/2010. Vysoké učení technické v Brně Fakulta informačních technologií Božetěchova 2, 612 66 Brno
Operační systémy IOS 2009/2010 Tomáš Vojnar Vysoké učení technické v Brně Fakulta informačních technologií Božetěchova 2, 612 66 Brno ÚÓ Ò Ö ØºÚÙØ ÖºÞ Úvod do UNIXu p.1/11 Unix úvod Úvod do UNIXu p.2/11
VíceAkademický rok: 2004/05 Datum: Příjmení: Křestní jméno: Osobní číslo: Obor:
Západočeská univerzita v Plzni Písemná zkouška z předmětu: Zkoušející: Katedra informatiky a výpočetní techniky Počítačová technika KIV/POT Dr. Ing. Karel Dudáček Akademický rok: 2004/05 Datum: Příjmení:
VíceLojza - návrh a realizace µprocesoru
Vyšší odborná škola a Střední průmyslová škola elektrotechnická Olomouc STŘEDOŠKOLSKÁ ODBORNÁ ČINNOST Obor 18. Informatika Lojza - návrh a realizace µprocesoru DESIGN AND REALIZATION OF MICROPROCESSOR
VíceOperační systémy. Přednáška 8: Správa paměti II
Operační systémy Přednáška 8: Správa paměti II 1 Jednoduché stránkování Hlavní paměť rozdělená na malé úseky stejné velikosti (např. 4kB) nazývané rámce (frames). Program rozdělen na malé úseky stejné
VícePřednáška 2 A4B38NVS - Návrh vestavěných systémů 2014, kat. měření, ČVUT - FEL, Praha J. Fischer A4B38NVS, 2014, J.Fischer, kat. měření, ČVUT - FEL 1
Přednáška 2 A4B38NVS - Návrh vestavěných systémů 2014, kat. měření, ČVUT - FEL, Praha J. Fischer A4B38NVS, 2014, J.Fischer, kat. měření, ČVUT - FEL 1 Modifikace bitů slova v SRAM nebo výstupní brány Funkce
VíceKoncepce DMA POT POT. Při vstupu nebo výstupu dat se opakují jednoduché činnosti. Jednotlivé kroky lze realizovat pomocí speciálního HW.
p 1 Koncepce DMA Při vstupu nebo výstupu dat se opakují jednoduché činnosti. Jednotlivé kroky lze realizovat pomocí speciálního HW. Čekání na připravenost V/V Přenos paměť V/V nebo V/V paměť Posun pointeru
Více